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Omron SYSMAC CQM1 Manuel De Programmation page 178

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Registre à décalage
5-16-9 REVERSIBLE SHIFT REGISTER – REGISTRE A DECALAGE
REVERSIBLE – SFTR(84)
Limites
Description
Drapeaux
Symboles
SFTR(84)
@SFTR(84)
C
St
E
Décale une donnée de 16 bits par unité de 1 bit vers la droite ou vers la gauche.
Réserver un canal de contrôle et un ou plusieurs canaux qui formeront le
registre à décalage réversible. St et E doivent appartenir à la même zone de
données et St doit être supérieur ou égal à E.
Les DM 6144 à 6655 ne peuvent être utilisés pour C, ni pour St, ni pour E.
SFTR(84) s'utilise pour créer un registre de décalage à canal unique ou à plu-
sieurs canaux capable de décaler les données vers la droite ou vers la gauche.
Pour créer un registre à canal unique, désignez le même canal pour St et E. Le
canal de contrôle produit le sens du décalage, l'état à entrer dans le registre,
l'impulsion de décalage et l'entrée de RAZ. Le canal de contrôle s'attribue de la
façon suivante :
MSB
15 14 13 12
Les données du registre à décalage sont décalées d'un bit dans le sens indiqué
par le bit 12, décalant ainsi un bit dans CY et l'état du bit 13 à l'autre extrémité à
chaque fois que SFTR(84) est exécutée avec une condition ON aussi longtemps
que le bit de RAZ est à OFFet le bit 14 à ON. Si SFTR(84) est exécutée avec une
condition OFF ou si SFTR(84) est exécutée avec le bit 14 à OFF, le registre à
décalage reste inchangé. Si SFTR(84) est exécutée avec une condition à ON et
le bit de RAZ (bit 15) à OFF, le registre à décalage entier et CY sont remis à zéro.
ER:
St et E n'appartiennent pas à la même zone de données ou ST est supé-
rieur à E.
Le canal DM indirectement adressé n'existe pas (le contenu du canal
*DM n'est pas en BCD ou la limite de la zone DM a été dépassée).
CY:
Reçoit l'état du bit 00 de St ou du bit 15 de E, selon la direction du déca-
lage.
Zones de données d'opérande
IR, SR, AR, DM, HR, LR
C
IR, SR, AR, DM, HR, LR
St
E
IR, SR, AR, DM, HR LR
Non utilisé
Sens du décalage
1 (ON):
LSB)
0 (OFF): droite à gauche (LSB à
MSB)
Etat à entrer dans le registre
Bit d'impulsion de décalage (horloge)
RAZ
Chapitre 5-16
C: canal de contrôle
St: canal de départ
E: canal de fin
LSB
gauche à droite (MSB à
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