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III-4.6
FLIP (flip-flop D - no. 65)
L'état du signal numérique à l'entrée statique signal est transmis à la sortie z1 lorsque
w
le signal à l'entrée clock change de 0 à 1 (flanc positif), et
w
l'entrée reinit est logique 0.
Si reinit = 1, la sortie z1 est forcée à 0, sans tenir compte des entrées signal et clock.
reinit a la priorité!
Les signaux d'entrée signal, clock et reinit doivent être appliqués pendant au moins la durée de l'inter-
valle d'échantillonage T
A l'état de mise en circuit (état initial), z1 = 0! Les entrées non utilisées sont interprétées comme logique 0.
a
Cette fonction possède une «mémoire». Cela signifie: après mise sous tension, elle poursuit son travail
avec les états z1 et not z1 de l'instant de coupure de l'alimentation (power-off), à la condition que
les données RAM soient encore inchangées.
Entrées/sorties
Entrées numériques
signal
clock
reinit
Sorties numériques
z1
not z1
FLIP (flip-flop D - no. 65)
signal
clock
reset
choisi pour ce bloc (100, 200, 400 ou 800ms).
r
Entrée D - Ce signal est sorti sur z1 par le flanc positif (0 r 1) de clock, à la condition que reset ne soit
pas 1.
Entrée d'impulsion - Un flanc positif transmet l'état instantané de l'entrée «signal» à la sortie z1, lorsque rei-
nit n'est pas 1.
L'entrée réinit - met z1 à 0
Sortie flip-flop
Sortie flip-flop NOT z1
z1
not z1
Fonctions logiques
III-109
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