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Installation / préparation à la mise en service
3.4.2 Interface SSI (en option)
En option, à la place de l'interface incrémentale, le système de mesure peut être équipé en plus d'une
interface SSI absolue série synchrone vers l'interface EtherNet/IP™.
3.4.2.1 Forme d'ondes
Au repos, les données+ et cadence+ sont sur High. Cela correspond au temps avant le point
le graphique ci-dessous.
Au premier changement du signal d'horloge de High sur Low (1), le monostable redéclenchable
interne au périphérique est défini avec un temps de monostable t
Le temps
détermine la fréquence de transmission minimale (T = t
M
supérieure est le résultat de la somme de tous les temps de propagation des signaux et est en plus
limitée par les circuits filtrants intégrés.
À chaque nouveau front d'horloge descendant, l'état actif du monostable augmente du temps t
le cas en dernier au point (4).
Avec le placement du monostable (1), les données parallèles au bit en attente sur le convertisseur
interne parallèle/série sont enregistrées par un signal généré en interne dans une bascule d'entrée du
registre à décalage. Ce qui permet de garantir que les données ne soient plus modifiées pendant la
transmission d'une valeur de position.
Au premier changement du signal d'horloge de Low sur High (2), le bit de valeur maximale (MSB) de
l'information du périphérique est déposé sur la sortie sérielle des données. À chaque nouveau front
ascendant, le bit de valeur suivante la plus basse est poussé sur la sortie de données.
Lorsque la fréquence d'horloge est terminée, les lignes de données sont maintenues pour la durée du
monostable t
(4)
à 0V (Low). Cela permet également d'obtenir le temps minimal de pause t
M
être observé entre deux séquences d'horloge consécutives et qui s'élève à 2 * t
Dès le premier front d'horloge ascendant, les données sont lues par le système électronique
d'évaluation. En raison de différents facteurs, on obtient une temporisation de t
Le système de mesure glisse ainsi les données sur la sortie avec une temporisation de t
raison pour laquelle une « pause 1 » est lue au moment (2). Celle-ci doit être rejetée ou peut être
utilisée en association avec un « 0 » après le bit LSB à des fins de contrôle de rupture de ligne. Le bit
MSB est lu seulement au moment (3). C'est pourquoi le nombre d'horloge doit toujours être supérieur
de un (n+1) au nombre de bits de données à transmettre.
TR-Electronic GmbH 2020, All Rights Reserved
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Cette interface supplémentaire n'est pas évaluée sur le plan de la
sécurité et ne doit pas être utilisée à des fins de sécurité !
L'interface est généralement utilisée à des fins de contrôle du transfert
des données de valeur absolue à une deuxième commande non axée
sur la sécurité.
TR-ECE-BA-F-0163 v06
.
M
/ 2). La fréquence limite
M
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M
>100 ns, sans câble.
V
Printed in the Federal Republic of Germany
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27.01.2022
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