Table des Matières
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01/13 MN05013001Z-FR
a
SR...BIT
Shift Register
EN
RE
Q1
0
Q2
0
Q3
0
Q4
0
Q5
0
Q6
0
BP
Q7
1
BD
Q8
0
SR..BD et SR..I2 sont des données que le module valide lors de
l'activation de SR..BP (impulsion vers l'arrière) dans le registre Q8
ou D8, a figure 148 et 149.
b
SR...BIT
Shift Register
EN
1
RE
Q1
0
Q2
0
Q3
0
Q4
0
Q5
0
Q6
1
BP
Q7
0
1
BD
Q8
1
Figure 148 : Registre à décalage SR.. : opération de décalage vers
l'arrière en mode BIT
a Situation initiale :
– SR..EN n'est pas activée ; le module n'est pas actif.
– Le bit de donnée 1 se trouve dans SR..Q7 ; les autres zones de
registre présentent la valeur 0.
b Validation d'un bit de donnée :
– SR..EN est activée ; le module est actif.
– SR..BD présente le bit de donnée 1.
– Lors de l'impulsion vers l'arrière via SR..BP, la zone de registre
SR..Q8 décale le contenu de toutes les zones de registre d'une posi-
tion en arrière et valide le 1 de SR..BD.
c Validation d'un bit de donnée :
– SR..EN est activée ; le module est actif.
– SR..BD présente le bit de donnée 0.
– Lors de l'impulsion vers l'arrière via SR..BP, la zone de registre
SR..Q8 décale de nouveau le contenu de toutes les zones de
registre d'une position en arrière et valide le 0 de SR..BD.
d Remise à zéro du registre :
– SR..EN est activée ; le module est actif.
– L'activation de SR..RE efface le contenu du registre.
SR, Registre à décalage
c
SR...BIT
Shift Register
EN
1
RE
Q1
Q2
Q3
Q4
Q5
Q6
BP
Q7
1
BD
Q8
0
d
SR...BIT
Shift Register
EN
1
1
RE
0
Q1
0
Q2
0
Q3
0
Q4
1
Q5
0
Q6
BP
1
Q7
BD
1
Q8
0
0
0
0
0
0
0
0
0
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