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Siemens 3RK7136-6SC00-0BC1 Manuel page 55

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IMPORTANT
La valeur de processus "0" n'est pas transmise de manière sécurisée.
Du fait du principe de transmission des séquences de code, la valeur de processus "1" est
transmise de manière sécurisée via AS-Interface, de sorte que la validation pour l'activation
d'une machine peut avoir lieu de manière sécurisée. Si une erreur devait se produire
pendant la transmission de la valeur "1", cette erreur serait détectée et la valeur de
remplacement "0" serait utilisée.
En revanche, la transmission de la valeur de processus "0" via AS-Interface n'est pas
sécurisée ; une transmission incorrecte de la valeur "0" ne peut pas être détectée. La
valeur "0" ne doit donc pas être utilisée comme information de sécurité qui déclenche une
action dangereuse (réponse "0" d'une position de commutateur, par exemple).
Tableau 6- 7 Affectation d'adresses de sortie dans la CPU F
Octet
Bits occupés dans la CPU F par module F-CM AS-i Safety ST
dans la
Bit 7
CPU F
x + 0
DQ0.7
Groupe de
commuta-
tion 7
x + 1
DQ1.7
Groupe de
commuta-
tion 15
x + 2
Acquitte-
ment d'er-
reur pour
DQ0.7
x + 3
Acquitte-
ment d'er-
reur pour
DQ1.7
x + 4
Réservé
...
x + 7
Réservé
X = adresse de début du module
Le bit d'acquittement d'erreur déclenche successivement les signaux AUX1 et AUX2.
Module de sécurité F‑CM AS‑i Safety ST (3RK7136‑6SC00‑0BC1)
Manuel, 03/2017, A5E03957059030A/RS-AB/002
Bit 6
Bit 5
DQ0.6
DQ0.5
Groupe de
Groupe de
commuta-
commuta-
tion 6
tion 5
DQ1.6
DQ1.5
Groupe de
Groupe de
commuta-
commuta-
tion 14
tion 13
Acquitte-
Acquitte-
ment d'er-
ment d'er-
reur pour
reur pour
DQ0.6
DQ0.5
Acquitte-
Acquitte-
ment d'er-
ment d'er-
reur pour
reur pour
DQ1.6
D1.5
Paramétrage / définition de l'espace d'adressage
Bit 4
Bit 3
DQ0.4
DQ0.3
Groupe de
Groupe de
commuta-
commuta-
tion 4
tion 3
DQ1.4
DQ1.3
Groupe de
Groupe de
commuta-
commuta-
tion 12
tion 11
Acquitte-
Acquitte-
ment d'er-
ment d'er-
reur pour
reur pour
DQ0.4
DQ0.3
Acquitte-
Acquitte-
ment d'er-
ment d'er-
reur pour
reur pour
DQ1.4
DQ1.3
6.3 Espace d'adressage
Bit 2
Bit 1
DQ0.2
DQ0.1
Groupe de
Groupe de
commuta-
commuta-
tion 2
tion 1
DQ1.2
DQ1.1
Groupe de
Groupe de
commuta-
commuta-
tion 10
tion 9
Acquitte-
Acquitte-
ment d'er-
ment d'er-
reur pour
reur pour
DQ0.2
DQ0.1
Acquitte-
Acquitte-
ment d'er-
ment d'er-
reur pour
reur pour
DQ1.2
DQ1.1
Bit 0
DQ0.0
Groupe de
commuta-
tion 0
DQ1.0
Groupe de
commuta-
tion 8
Acquitte-
ment d'er-
reur pour
DQ0.0
Acquitte-
ment d'er-
reur pour
DQ1.0
55

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