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Point de test
Nom Réseau
TP420
CPU_D8
TP421
CPU_D9
TP449
CPU_D10
TP450
CPU_D11
TP451
CPU_D12
TP452
CPU_D13
TP453
CPU_D14
TP454
CPU_D15
TP455
CPU_A0
TP463
CPU_A1
TP494
CPU_A2
TP495
CPU_A3
TP496
CPU_A4
TP497
CPU_A5
TP498
CPU_A6
TP499
CPU_A7
TP300
CPU_A8
TP301
CPU_A9
TP302
CPU_A10
TP303
CPU_A11
TP304
CPU_A12
TP305
CPU_A13
TP306
CPU_A14
TP307
CPU_A15
TP308
CPU_A16
TP309
CPU_A17
TP310
CPU_A18
TP311
CPU_A19
TP312
CPU_A20
TP313
CPU_A21
TP314
CPU_A22
TP315
CPU_A23
TP350
NCEO_A
TP351
EN1_A
TP352
EN0_A
TP353
VCC3_EN_A
TP354
VCC5_EN_A
TP401
I_FLAG_A
TP365
INIT_DONE_A
TP364
RDNBSY_A
TP372
CLKUSR_A
TP355
CONF_DONE_C1
TP456
RESET_A
TP457
A4_A
TP373
A2_A
TP374
A_PLL_2
TP458
DATA_CI
TP375
DEV_CLRN_A
TP459
/CS_1EEE1394
TP460
/CS_CI_B
TP376
CD7
TP493
CD6
TP492
CD5
TP491
CD4
TP479
CD3
TP478
CD2
TP477
CD1
TP476
CD0
Page 5
Sortie Vidéo/Audio
TP504
SCRESET/RTC
TP515
TTXREQ
TP514
TTXDATA
TP516
RSET
TP500
/VSYNC_AV
TP502
ALSB
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Fonction
Bus principal de données UC bit 8
Bus principal de données UC bit 9
Bus principal de données UC bit 10
Bus principal de données UC bit 11
Bus principal de données UC bit 12
Bus principal de données UC bit 13
Bus principal de données UC bit 14
Bus principal de données UC bit 15
Adresse UC principale bit 0
Adresse UC principale bit 1
Adresse UC principale bit 2
Adresse UC principale bit 3
Adresse UC principale bit 4
Adresse UC principale bit 5
Adresse UC principale bit 6
Adresse UC principale bit 7
Adresse UC principale bit 8
Adresse UC principale bit 9
Adresse UC principale bit 10
Adresse UC principale bit 11
Adresse UC principale bit 12
Adresse UC principale bit 13
Adresse UC principale bit 14
Adresse UC principale bit 15
Adresse UC principale bit 16
Adresse UC principale bit 17
Adresse UC principale bit 18
Adresse UC principale bit 19
Adresse UC principale bit 20
Adresse UC principale bit 21
Adresse UC principale bit 22
Adresse UC principale bit 23
CI 1 Activation configuration terminée
CI 1 Activation VPP 1
CI 1 Activation VPP 0
CI 1 Activation VCC 3V3
CI 1 Activation VCC 5V
CI 1 Indication d'erreur IC401
CI 1 Initialisation terminée
CI 1 Ligne configuration prête
CI 1 Horloge d'initialisation optionnelle
CI Configuration prête/terminée
CI 1 Remise à zéro module UC
CI 1 Bus adresse bit 4
CI 1 Bus adresse bit 2
Audio PLL sélection 2
CI Données de configuration
CI 1 Activation effacement registre
Sélection de circuit IEEE1394 LLC
Sélection de circuit CI 2
Données train de transport FE à CI 1 bit 7
Données train de transport FE à CI 1 bit 6
Données train de transport FE à CI 1 bit 5
Données train de transport FE à CI 1 bit 4
Données train de transport FE à CI 1 bit 3
Données train de transport FE à CI 1 bit 2
Données train de transport FE à CI 1 bit 1
Données train de transport FE à CI 1 bit 0
Module commande remise à zéro sous-porteuse/temps réel
Signal de demande données télétexte
Entrée données télétexte
Réglage pour amplitude pleine échelle des signaux vidéo
Synchronisation trame/V
Entrée adresse TTL
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