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4.4.4
Chipset
Le menu chipset vous permet de modifier les paramètres avancés du chipset.
Choisissez un élément et pressez <Entrée> pour afficher le sous-menu.
Advanced Chipset Settings
Configure DRAM Timing by SPD
Hyper Path 3
DRAM Throttling Threshold
Boot Graphic Adapter Priority
PCI]
PEG Buffer Length
Link Latency
PEG Root Control
Slot Power
High Priority Port Select
v02.53 (C)Copyright 1985-2007, American Megatrends, Inc.
Configure DRAM Timing by SPD [Enabled]
Lorsque cet élément est activé, les paramètres de timing de DRAM sont réglés en
fonction du SPD de la DRAM (Serial Presence Detect). Désactivé, vous pouvez
régler les paramètres de timings DRAM manuellement via les sous-éléments. Les
sous-éléments suivants apparaissent lorsque cet élément est passé sur Disabled.
Options de configuration: [Disabled] [Enabled]
DRAM CAS# Latency [5 Clocks]
Contrôle la latence entre la commande de lecture SDRAM et le temps auquel
la donnée devient effectivement disponible.
Options de configuration: [6 Clock] [5 Clocks] [4 Clocks] [3 Clocks]
DRAM RAS# Precharge [4 Clocks]
Contrôle les périodes d'inactivité après avoir envoyé une commande
précharge à la DDR SDRAM. Options de configuration: [2 Clocks] [3 Clocks]
[4 Clocks] [5 Clocks] [6 Clocks]
DRAM RAS# to # Delay [4 Clocks]
Contrôle la latence entre la commande active de la DDR SDRAM et la
commande lecture/écriture. Options de configuration: [2 Clocks] [3 Clocks] [4
Clocks] [5 Clocks] [6 Clocks]
DRAM # Activate to Precharge [15 Clocks]
Options de configuration: [4 Clocks] [5 Clocks] ~ [18 Clocks]
DRAM Write Recovery Time [4 Clocks]
Options de configuration: [2 Clocks] [3 Clocks] [4 Clocks] [5 Clocks] [6
Clocks]
ASUS P5GC
[Enabled]
[Auto]
[Auto]
[PCI Express/
[Auto]
[Auto]
[Auto]
[Auto]
[Disabled]
Manual DRAM
Frequency Setting or
Auto by SPD
Select Screen
Select Item
+-
Change Field
Tab
Select Field
F1
General Help
F10
Save and Exit
ESC
Exit
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