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VALINA est équipé d'un port JTAG/Debug, disponible sous le
couvercle TELECOM, à des fins d'amélioration et de réparation.
Ce port peut être utilisé pour connecter une interface PACIFIC
Debug à des fins de débogage et d'enregistrement. Ce port
peut être utilisé pour connecter une interface JTAG à des fins
de réparation et de reflashage.
Les interfaces suivantes sont disponibles sur ce port :
• interface JTAG vers ASIC
• interface 3.3V UART vers Core 1 (sécurisée – UART_A3)
• interface 3.3V UART vers Core 2 (non sécurisée – UART_B3)
1
Figure 19 : Port JTAG/Debug
Le port JTAG/Debug utilise un connecteur monté sur ressort
de 2,54 mm.
Brochage pour le port JTAG/Debug – port à ressort
Broche
Description
1
3,3V
2
GND
3
TRSTn
4
GND
5
TDI
6
GND
7
TMS
8
GND
9
TCK
10
GND
9 Port JTAG/Debug
1
Broche
Description
11
TDO
12
GND
13
3,3V
14
12C_SCL
15
12C_SDA
16
SRSTn
17
UART4_RXD
18
UART4_TXD
19
UART5_RXD
20
UART5_TXD
Le port JTAG/Debug est également disponible via une tête
de broche de 1,27 mm, disponible sur les prototypes et les
terminaux de développement.
Brochage du port JTAG/Debug – tête de broche
Broche
Description
Broche
1
GND
7
2
TCK
8
3
TDI
9
4
TDO
10
5
TMS
11
6
TRSTn
12
Description
SRSTn
3,3V
UART4_ RXD (débogage)
UART4_TXD (débogage)
UART4_ RXD (débogage)
UART5_TXD (débogage)
21
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