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1..n, Liste affect
Logiqu . LE22.Port In4-
I
Logiqu . LE22.Réin
mémor-I
Logiqu . LE23.Port Out
Logiqu . LE23.Tempo
exp
Logiqu . LE23.Out
Logiqu . LE23.Out
inversé
Logiqu . LE23.Port In1-
I
Logiqu . LE23.Port In2-
I
Logiqu . LE23.Port In3-
I
Logiqu . LE23.Port In4-
I
Logiqu . LE23.Réin
mémor-I
Logiqu . LE24.Port Out
Logiqu . LE24.Tempo
exp
Logiqu . LE24.Out
Logiqu . LE24.Out
inversé
Logiqu . LE24.Port In1-
I
Logiqu . LE24.Port In2-
I
Logiqu . LE24.Port In3-
I
Logiqu . LE24.Port In4-
I
Logiqu . LE24.Réin
mémor-I
Logiqu . LE25.Port Out
Logiqu . LE25.Tempo
exp
MCDLV4-3.7-FR-REF
Description
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Signal de réinitialisation pour la
mémorisation de l'état
Signal : Sortie de la porte logique
Signal : Sortie de la temporisation
Signal : Sortie mémorisée (Q)
Signal : Sortie mémorisée inversée (Q NOT)
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Signal de réinitialisation pour la
mémorisation de l'état
Signal : Sortie de la porte logique
Signal : Sortie de la temporisation
Signal : Sortie mémorisée (Q)
Signal : Sortie mémorisée inversée (Q NOT)
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Affectation du signal d'entrée
État de l'entrée du module : Signal de réinitialisation pour la
mémorisation de l'état
Signal : Sortie de la porte logique
Signal : Sortie de la temporisation
MCDLV4
16 Listes sélect
571
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