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Chapitre 3
Transfert de données
Handshake
Plage de données de sortie
Plage de données d'entrée
Schéma de fluxe
BAL C9090 IBS FR 1.01
Commande Interbus
Le transfert de données se fait par l'émission de données de process cycliques
(canal PD), qui sont copiées dans la plage de données de sortie. Le nombre des
octets de données de sortie (2...20) doit être paramétré à la phase 10 du menu
(voir chapitre 4).
Le premier octet dans la plage de données d'entrée est utilisé pour le handshake.
Les autres données dans la zone d'entrée sont aléatoires et sans signification.
Le transfert de données par le canal PCP n'est pas implémenté.
Le système Interbus impose un transfert de données de façon cyclique. Les
données se situant dans les plages d'entrées et de sorties du maître sont
échangées de façon cyclique entre le maître et l'esclave. De ce fait, les nouvelles
données doivent être marquées par un handshake. Les nouvelles données ne sont
prises en compte qu'une seule fois et la réitération cyclique de ces mêmes
données est simplement ignorée.
Le handshake marque de nouvelles données du maître pour l'afficheur
(handshake d'envoi) et vérifie si l'afficheur est prêt à recevoir des données (Busy-
Check).
Le bit 0 (bit TxhS) du premier octet (octet TxHS) dans la plage de données de
sortie est réservé pour le handshake d'envoi. Les bits 7..1 doivent être mis à 0 par
le maître.
Octet 0 (octet TxHS)
7
6
5
4
3
2
1
0
:
:
:
:
:
:
:
: ––––––––––––––––––––––– Données utiles –––––––––––––––––––––
:
:
:
:
:
:
:
:
:
:
:
:
:
:
:
↕
:
:
:
:
:
:
:
0
0
0
0
0
0
0
Bits 7...1 doivent être mis à 0 par le maître
Pour le contrôle Busy, le bit 7 (bit RxHS) de l'unique octet de la plage de données
d'entrée (octet RxHS) est réservé. Les bits 6...0 sont interprétés par le maître
comme 0.
Octet 0 (octet RxHS)
7
6
5
4
3
2
1
0
:
:
:
:
:
:
:
:
:
0
0
0
0
0
0
0
:
↕
RxHS-Bit (contrôlé par l'esclave)
Lors du démarrage, le maître doit mettre le bit TxHS à la valeur du bit RxHS.
L'afficheur est prêt à réceptionner des données dès que le bit RxHS a la même
valeur que le dernier bit TxHS envoyé. Dès lors, le maître peut envoyer de
nouvelles données à l'afficheur. Le maître marque les nouvelles données par un
changement d'état du bit TxHS (toggle). L'afficheur signale après un bref
traitement qu'il est de nouveau prêt à recevoir des données en faisant
correspondre le bit RxHS à celui du dernier bit TxHS reçu.
Octet 1
Octet 2
7 --------------- 0
7 --------------- 0
TxHS-Bit (à contrôler par le maître)
Bits 6...0 interprétés comme 0
Octet (n – 1)
7 --------------- 0
7
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